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FPGA性能设计培训

机构名称: 北京中科信软科技有限公司

班型:     全日制 周末班 随到随学

上课地点:北京市海淀区中关村恒兴大厦  公交/驾车

分 享 到:

课程详情

课程对象

对 FPGA 设计优化感兴趣、具备 HDL 中级知识和拥有 Xilinx ISE® 软件工具使用经验的 FPGA 设计者。

课程概要
1
  • 回顾 FPGA 设计基础
  • 利用 FPGA 资源进行设计
  • 内核生成器(CORE Generator)软件系统
  • 基本 FPGA 时钟资源
  • Virtex-6 和 Spartan-6 FPGA 时钟资源
  • 实验1:利用 FPGA 资源进行设计
  • FPGA 设计技术
  • 综合技术
  • 实验2:综合技术
2
  • 实现时序收敛
  • 实验3:回顾全局时序约束
  • 特定通路时序约束,第1部分
  • 特定通路时序约束,第2部分
  • 实验4:实现时序收敛
  • 高级实现选项
  • 实验5:性能设计
  • 实验6:FPGA Editor 演示(可选)
  • ChipScope Pro 软件(可选)
  • 实验7:ChipScope Pro 软件(可选)

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重要提示:本课程设有抵用券,机构报名缴款时可抵$Money$学费
重要提示:网上报名或咨询后,告知学了吗已向机构缴款即可获赠30元话费